逻辑收发器74LVC245APW 八进制总线收发器 74LVC245 Nexperia安世半导体

 
 
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更新 2025-01-06 17:00
 

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详细说明
逻辑收发器74LVC245APW74LVC245APW
八进制总线收发器;3态
74LVC245A;74LVCH245A是8位收发器,在发送和接收方向上都具有非反相3态总线兼容输出。该器件具有一个可实现轻松级联的输出使能(OE)输入和一个可实现方向控制的发送/接收(DIR)。OE控制输出,因此总线可以得到有效隔离。
输入可通过3.3 V或5 V器件进行驱动。禁用时,可以向输出施加高达5.5 V的电压。这些特性允许将这些器件用于混合3.3 V和5V应用。
74LVCH245A数据输入上的总线保持无需使用外部上拉电阻来保持未使用的输入。
特性和优势
5 V容压输入/输出,可实现与5 V逻辑的接合
1.2 V至3.6 V的宽电源电压范围
CMOS低功耗
具有TTL电平的直接接口
输入可接受高达5.5 V的电压
VCC = 0 V时的高阻抗
所有数据输入上的总线保持(仅74LVCH245A)
符合JEDEC标准:
JESD8-7A(1.65 V至1.95 V)
JESD8-5A(2.3 V至2.7 V)
JESD8-C/JESD36(2.7 V至3.6 V)

ESD保护:
HBM JESD22-A114F超过2000 V
MM JESD22-A115B超过200 V
CDM JESD22-C101E超过1000 V

额定温度范围为-40 °C至+85 °C和-40 °C至+125 °C逻辑收发器74LVC245APW74LVC245APW
八进制总线收发器;3态
74LVC245A;74LVCH245A是8位收发器,在发送和接收方向上都具有非反相3态总线兼容输出。该器件具有一个可实现轻松级联的输出使能(OE)输入和一个可实现方向控制的发送/接收(DIR)。OE控制输出,因此总线可以得到有效隔离。
输入可通过3.3 V或5 V器件进行驱动。禁用时,可以向输出施加高达5.5 V的电压。这些特性允许将这些器件用于混合3.3 V和5V应用。
74LVCH245A数据输入上的总线保持无需使用外部上拉电阻来保持未使用的输入。
特性和优势
5 V容压输入/输出,可实现与5 V逻辑的接合
1.2 V至3.6 V的宽电源电压范围
CMOS低功耗
具有TTL电平的直接接口
输入可接受高达5.5 V的电压
VCC = 0 V时的高阻抗
所有数据输入上的总线保持(仅74LVCH245A)
符合JEDEC标准:
JESD8-7A(1.65 V至1.95 V)
JESD8-5A(2.3 V至2.7 V)
JESD8-C/JESD36(2.7 V至3.6 V)

ESD保护:
HBM JESD22-A114F超过2000 V
MM JESD22-A115B超过200 V
CDM JESD22-C101E超过1000 V

额定温度范围为-40 °C至+85 °C和-40 °C至+125 °C


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